11 月 24 日消息，在本月早些时候的 sc25 大会上，cxl 联盟发布了 cxl 4.0 规范。这版规范基于 pcie 7.0 构建，数据速率达 128gt/s，吞吐量是上代 cxl 3.0 的 2 倍。
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除速率的提升外，CXL 4.0 还在系统架构和拓扑方面提供了更高的灵活性，其支持原生 ×2 宽度、支持最多 4 个重定时器 (Retimer)、允许多个上游端口聚合捆绑为一个逻辑实体；此外其拥有更强的内存可靠性和可维护性，能满足下一代数据密集型应用的需求。
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